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23個職缺: 最新其他工程類(電機、半導體)職缺
【新竹/台中/台南】工程師 ※語言不拘※-日系電子貿易公司ID:19599
40,000 NTD ~ 60,000 NTD新竹, 台中, 台南工作內容
※ 在台成立至今將屆 50 年,公司代理全球知名品牌之半導體、機械設備、光學產品、分析儀器、真空產品等【工作內容】・真空 pump、分析儀器設備等維護與安裝・處理客戶所提出產品相關應用之技術問題・提供客戶技術支援/維修服務及教育訓練・配合業務與客戶的需求,拆裝設備與故障排除・服務產品:半導體真空相關產品、光學鍍膜冷凝系統、 離子源、ThermoStream等儀器・服務對象:半導體公司、太陽能光電/光學業、IC 設計公司、Transciever 製造廠、學術研究單位等【公司組織】・全體: 約65位・部門人數: 新竹辦公室 10位以上 / 台中辦公室 4位 / 台南辦公室 4位
福利制度
【法定項目】
・勞健保
・加班費
・各種休假(特別休假、婚假、喪假、生理假、產檢假、陪產假、產假、育嬰假)
・退休金
【企業福利制度】
・年終:平均4個月(1年發放2次,依業績浮動)
・優於法規的休假制度
・定期健康檢查(含1天公假)
・員工旅行
・企業尾牙
・久任員工獎勵【台北】FAE業務支援工程師※N1※歡迎新鮮人or無經驗者!! -知名日系被動電子元件製造商ID:18731
35,000 NTD ~ 50,000 NTD台北工作內容
【工作內容】・負責電容/電感/RF 相關產品,協助業務人員產品擴販及技術支援相關工作・市場機種情報搜集整理及調查・商品擴販、企劃【公司魅力】・日本東證上市知名電子零件製造商,規模大且在台歷史悠久。・公司內部福利制度與人事制度完善、提供教育培訓制度也完善,辦公室寬敞整潔。
福利制度
【法定項目】
・勞健保
・加班費
・各種休假(特別休假、婚假、喪假、生理假、產檢假、陪產假、產假、育嬰假)
・退休金
【公司福利】
・年終獎金:1年發放2次(平均2~3個月, 依照公司業績以及個人表現)
・每年調薪及升遷制度
・新人任職滿6個月即享有4天特休(優於勞基法)
・生日當月享有生日假一天,並致贈生日電子禮券
・年末、農曆年前一天享有提早下班福利
・重要節日(春節、勞動節、端午節、中秋節)發放電子禮券,每半年再加發一筆電子禮券
・每年安排團體員工旅遊
・享有各式特約商店折扣,涵蓋餐飲美食、SPA 按摩等
・提供結婚禮金、生育補助金、喪葬補助金、住院補助金、育兒補助金
・每年提供優於一般企業的健檢套組,並額外給予一日有薪健檢假
・每年安排員工免費接種流感疫苗(非強制)
・定期舉辦健康衛教講座,與安排臨場護理師一對一健康訪談
・提供個人進修課程補助(如Office軟體、語言學習等)
・在職教育訓練、新人完善教育訓練
・不定期舉辦實用性高、涵蓋生活與職場安全的主題講座(包含交通安全、防災知識、心理調適等講座)【台南】半導體設備維護工程師※日文N3、歡迎理科新鮮人※-日系半導體設備供應商ID:19177
62,000 NTD ~ 62,000 NTD台南工作內容
【概要】知名日系跨國集團之旗下半導體設備供應商招募【台南】半導體設備維護工程師【工作內容】・半導體設備機台裝設、維修、保養・機台問題分析與解決・社內一般事務處理・國內、海外設備業務支援※可配合加班/輪班、需3休3輪班【員工人數】總人數約640名
福利制度
【法定項目】
・勞健保
・加班費
・各種休假(特別休假、婚假、喪假、生理假、產檢假、陪產假、產假、育嬰假)
・退休金
【公司福利】
・ 一年三次獎金(過往平均約2個月以上)
・各項勤務津貼: 根據實際工作內容,提供完善勤務津貼。
・優於勞基法的加班計算倍率
・定期健康檢查、辦公室免費舒壓按摩、豐富運動器材
・優於勞基法的特別休假制度、全薪病假
・國內外培訓制度、學習補助、日語課程
・福利活動:尾牙、家庭日、旅遊、聚餐等
・各辦公室設置飲料櫃、點心 供員工自由取用
・提案獎金、久任獎金、久任假等
・豐富活動、多元的發展-社團活動、生日禮金【台北】維修工程師※日文N2※-日系半導體相關製造業ID:19100
35,000 NTD ~ 50,000 NTD台北工作內容
涵蓋範圍至先端半導體科技產品之有效運用,主要以主動被動零件、電子視覺影像相關產品、半導體加工設備與平板顯示液晶製成設備等製造代理,及相關進出口業務。【工作內容】・負責機台設備之安裝、維修及售後服務・半導體前後段製程、LSI 製程、光電製程、FPD製程(LCD、CF、PDP) 之研磨加工、洗淨、檢測等設備【員工人數】21人
福利制度
【法定項目】
・勞健保
・加班費
・各種休假(特別休假、婚假、喪假、生理假、產檢假、陪產假、產假、育嬰假)
・退休金
【企業福利制度】
・固定獎金 (保證1.5個月)
・公司年度業績獎金
・暑假 (3-5天,比照日本休假天數調整)
・生育禮金、久任獎勵金(依年資給予)
・尾牙、不定期員工旅遊
・每年健康檢查
・教育訓練制度 (依個人情況不同)
・專業證照課程全額補助 (依個人情況不同)【新竹】配管設計※語言不拘※-日本半導體相關產業ID:18515
45,000 NTD ~ 60,000 NTD新竹工作內容
日系大型基礎建設企業招募配管設計專員!【工作內容】・訂單確定後的設計業務,包括空間管理、管線設計及單元設計・客戶應對與會議洽談、流程圖繪製、配置設計・設備採購與調度設計、結構設計、現場施工的技術支援及各類文件製作【魅力】・隨著半導體需求持續增長,公司營收穩定・可學習日本半導體相關產業的技術
福利制度
【法定項目】
・勞健保
・加班費
・各種休假(特別休假、婚假、喪假、生理假、產檢假、陪產假、產假、育嬰假)
・退休金
【公司福利】
・餐費津貼
・員工旅遊(例:泰國)
・升遷制度
・獎金(一年1次,平均2~3個月左右)
・出差津貼
・員工聚餐【新竹】設備課長-知名電子材料製造商ID:18823
50,000 NTD ~ 80,000 NTD新竹工作內容
【工作内容】・熟悉PLC程式設計・具備機械識圖及軟體繪圖能力・設備保養與維護工作・設備異常故障分析及改善專案・具備電控系統查修與維護作業能力・工程計算分析、撿料・預算編製、設備採購與監造・廠內各項安全改善活動推進
福利制度
【法定項目】
・勞健保
・加班費
・各種休假(特別休假、婚假、喪假、生理假、產檢假、陪產假、產假、育嬰假)
・退休金
【企業福利制度】
・獎金(平均約2.3個月,視業績而定)
・職務津貼
・語言津貼
・員工餐廳(公司負擔)
・交通津貼
・全勤獎金
・健康檢查(一年一次)【遠端】資深記憶體電路設計工程師 (Memory Circuit)-馬來西亞IC設計企業ID:19541
面議その他工作內容
【工作模式】依個人經驗與能力評估,前期預計需於馬來西亞檳城總公司任職約1~2年,熟悉產品、技術與內部開發流程。後續視業務與團隊需求,可轉為台灣據點遠端工作模式。【職務內容】誠徵具備記憶體電路設計經驗之工程師,負責高效能、低功耗SRAM及/或多埠Register File(RF)Macro設計與驗證,並整合至Memory Compiler系統中。本職務將負責從規格定義、電晶體層級設計、Simulation到Silicon Correlation之完整開發流程。【工作內容】- 負責SRAM及/或多埠Register File(RF)之電晶體層級(Transistor-level)電路設計,包括: - Bitcell - Peripheral Circuit- 定義Memory Architecture/Topology,以達成以下目標: - Power - Performance - Area - Yield - Vmin- 執行Schematic Capture與SPICE Simulation,包括: - PVT Corner - Monte Carlo Analysis 並完成Read/Write Margin收斂。- 分析與優化關鍵路徑,包括: - Decoder - Wordline Driver - Sense Amplifier - Write Driver - IO Circuit 以提升速度與穩定性。- 製作Margin/Performance分析報告,並追蹤Design Closure相關指標。- 執行Post-layout Verification,包括: - Extraction - Sign-off Simulation 並與Layout團隊合作完成Pitch-matched Array設計。- 與以下團隊合作: - Design Automation Team - Software Team - EDA Vendor- 將Memory Circuit整合至Memory Compiler系統中。- 自動化產生與建立以下Collateral View與Model: - Liberty - LEF - Verilog - Timing/Power Model- 支援Silicon Bring-up、Characterization與Simulation-to-Silicon Correlation。
福利制度
【法定項目】
・依照馬來西亞當地法定制度
【公司福利】
・年假:14天起
・病假:14天起
・醫療保險
・牙科/眼科補助:每年 RM500
・門診補助:每年 RM1,000
・績效獎金
・年度調薪【遠端】資深類比電路工程師 (Pure Analog)-馬來西亞IC設計企業ID:19540
面議その他工作內容
【工作模式】依個人經驗與能力評估,前期預計需於馬來西亞檳城總公司任職約1~2年,熟悉產品、技術與內部開發流程。後續視業務與團隊需求,可轉為台灣據點遠端工作模式。【職務內容】誠徵具備類比/混合訊號IC設計經驗之工程師,負責高效能Analog/Mixed-Signal IP開發,從架構規劃、電路設計、Tape-out到Silicon Bring-up皆需參與。※職級將依經驗與能力評估。【工作內容】• 參考電路設計:包含 Bandgap、Bias Circuit、Reference Voltage/Current 等,需具備高精度、低雜訊設計能力。• 低 Offset/低 Noise 的 LDO(低壓差線性穩壓器)設計,以及穩定性/補償網路設計;進行 PSRR 與瞬態反應最佳化。• 電壓與電源監控電路設計:包含 Droop Detection、Voltage Detector、PowerGood、POR(Power-On Reset)、Analog Sensing 及 Housekeeping Block 等。• 電源管理相關元件設計,包含 Linear 與 Switching 周邊模組、Charge Pump 等,應用於 SoC/PHY 環境。• 設計/支援 ADC/DAC 模組及相關類比支援電路(如 Sampling、Reference、Amplifier/Comparator、Clocking 等)。• 電壓與溫度感測器設計與特性分析:包含 Bandgap 與 PTAT 架構溫度感測、Process Corner Detection Circuit,以及 Sensor Readout、數位化與 Calibration 技術。• 獨立負責完整 Block/IP 開發流程:包含架構研究、規格制定、Transistor-Level Design、Simulation、Post-Layout Sign-off 與 Silicon Bring-up/Characterization。• 建立 Verification Test Bench,並驗證 PVT Corner、Mismatch/Monte Carlo(適用時)及 Post-Extraction Parasitics 下的電路表現。• 與 Layout/Mask Designer 密切合作:包含 Floorplan 建議、Layout Review,以及確保 LVS/DRC Clean 與寄生效應考量。• 符合品質與可靠度要求(例如 EM/IR、Aging/Overstress),並協助建立 Robust Design Methodology 與 Sign-off Checklist。• 支援 IP 整合至 Testchip,以及 Post-Silicon Evaluation,包含與 Simulation 結果比對、First Silicon Bring-up 的 Root Cause Analysis 等工作。
福利制度
【法定項目】
・依照馬來西亞當地法定制度
【公司福利】
・年假:14天起
・病假:14天起
・醫療保險
・牙科/眼科補助:每年 RM500
・門診補助:每年 RM1,000
・績效獎金
・年度調薪【遠端】資深類比電路設計工程師(高速I/O)-馬來西亞IC設計企業ID:19539
面議その他工作內容
【工作模式】依個人經驗與能力評估,前期預計需於馬來西亞檳城總公司任職約1~2年,熟悉產品、技術與內部開發流程。後續視業務與團隊需求,可轉為台灣據點遠端工作模式。【職務內容】Sr Analog Circuit Design Engineer (High-Speed I/O)誠徵Sr Analog Circuit Design Engineer (High-Speed I/O),負責開發高效能類比/混合訊號 IP,涵蓋從架構設計、Tapeout 到 Silicon Bring-up 的完整流程。此職務需具備以下 High-Speed I/O 領域之專業經驗。※職級將依經驗與能力評估。【工作內容】• 設計 TX/RX、高速類比前端(Analog Front-End)、Serializer/Deserializer、高速 Level Shifter、Predriver/Driver,以及 Termination/Impedance Calibration 等模組。• Equalization 技術設計:包含 Feed-Forward Equalization(FFE)、DFE、CTLE 及相關 Adaptation/Control Loop。• 支援高速介面 Clocking 設計,例如 CDR 互動、低 Jitter Clock 產生與分配等 PHY 相關功能。• 進行 SI(Signal Integrity)分析,建立/驗證 IBIS/IBIS-AMI Model;執行 Channel Characterization(Insertion Loss、Return Loss、Crosstalk)及 Eye Diagram Margin 評估。• 獨立負責完整 Block/IP 開發流程:包含架構研究、規格制定、Transistor-Level Design、Simulation、Post-Layout Sign-off 與 Silicon Bring-up/Characterization。• 建立 Verification Test Bench,並驗證 PVT Corner、Mismatch/Monte Carlo(適用時)及 Post-Extraction Parasitics 下的電路表現。• 與 Layout/Mask Designer 密切合作:包含 Floorplan 建議、Layout Review,以及確保 LVS/DRC Clean 與寄生效應考量。• 支援高速介面整合與 Sign-off:包含 PPA(Power/Performance/Area)最佳化、可靠度檢查(例如 EM/IR、Aging/Overstress)及 Timing Closure 協作。• 支援 IP 整合至 Testchip,以及 Post-Silicon Evaluation,包含與 Simulation 結果比對、First Silicon Bring-up 的 Root Cause Analysis 等工作。
福利制度
【法定項目】
・依照馬來西亞當地法定制度
【公司福利】
・年假:14天起
・病假:14天起
・醫療保險
・牙科/眼科補助:每年 RM500
・門診補助:每年 RM1,000
・績效獎金
・年度調薪【遠端】資深類比電路設計工程師(Clocking) -馬來西亞IC設計企業ID:19538
面議その他工作內容
【工作模式】依個人經驗與能力評估,前期預計需於馬來西亞檳城總公司任職約1~2年,熟悉產品、技術與內部開發流程。後續視業務與團隊需求,可轉為台灣據點遠端工作模式。【職務內容】誠徵Sr Analog Circuit Design Engineer (Clocking),負責開發高效能類比/混合訊號 IP,涵蓋從架構設計、Tapeout 到 Silicon Bring-up 的完整流程。此職務需具備以下 Clocking 領域之專業經驗。※職級將依經驗與能力評估。【工作內容】• 設計與除錯 PLL/DLL 架構及相關電路(包含 Integer/Fractional-N;Analog 或 Digital-Assisted 架構)。• 振盪器(Oscillator)設計:包含 LC 或 Ring Oscillator(RO)VCO/DCO、Frequency Synthesis、Phase Noise/Jitter 分析與 Budget 規劃。• Delay Line、Measurement/Ruler Circuit、Phase Interpolator,以及 Calibration/Trim 技術開發。• DCC/DCM/DCA、Clock Tree/Distribution 與 Clock Management Unit 設計;負責低 Jitter Clock 產生與分配網路。• 獨立負責完整 Block/IP 開發流程:包含架構研究、規格制定、Transistor-Level Design、Simulation、Post-Layout Sign-off 與 Silicon Bring-up/Characterization。• 進行 Behavioral Modeling(例如 Verilog-A/SystemVerilog),用於分析 Loop Dynamics、Spur/Jitter 抑制及 System Interaction。• 建立 Verification Test Bench,並驗證 PVT Corner、Mismatch/Monte Carlo(適用時)及 Post-Extraction Parasitics 下的電路表現。• 與 Layout/Mask Designer 密切合作:包含 Floorplan 建議、Layout Review,以及確保 LVS/DRC Clean 與寄生效應考量。• 符合品質與可靠度要求(例如 EM/IR、Aging/Overstress),並協助建立 Robust Design Methodology 與 Sign-off Checklist。• 支援 IP 整合至 Testchip,以及 Post-Silicon Evaluation,包含與 Simulation 結果比對、First Silicon Bring-up 的 Root Cause Analysis 等工作。
福利制度
【法定項目】
・依照馬來西亞當地法定制度
【公司福利】
・年假:14天起
・病假:14天起
・醫療保險
・牙科/眼科補助:每年 RM500
・門診補助:每年 RM1,000
・績效獎金
・年度調薪